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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>如何使用FPGA實現(xiàn)結(jié)構(gòu)化LDPC碼的高速編譯碼器

      如何使用FPGA實現(xiàn)結(jié)構(gòu)化LDPC碼的高速編譯碼器

      2021-03-26 | rar | 0.45 MB | 次下載 | 免費

      資料介紹

      　　提出一種高吞吐量、低復(fù)雜度、可擴展的非正則低密度校驗（Low density parity check，LDPC）碼準(zhǔn)并行編碼結(jié)構(gòu)及譯碼結(jié)構(gòu)及其實現(xiàn)方案，該編碼結(jié)構(gòu)和譯碼結(jié)構(gòu)針對不同碼長的非正則結(jié)構(gòu)化LDPC碼可進行相應(yīng)擴展通過對編譯碼算法，優(yōu)化編譯碼結(jié)構(gòu)進行調(diào)整，降低了編譯碼囂硬件實現(xiàn)中的關(guān)鍵路徑遲延，并采用Xilinx公司的Virtex一4 VLX80 FPGA芯片實現(xiàn)了一個碼長10 240，碼率1／2的非正則結(jié)構(gòu)化LDPC碼編碼器和譯碼器。實現(xiàn)結(jié)果表明：該編碼器信息吞吐量為1．878 Gb／s，該譯碼器在采用18次迭代情況下信息吞吐量可迭223 Mb／s。

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