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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>數(shù)字信號處理論文>基于CPLD的多通道數(shù)據(jù)采集系統(tǒng)設(shè)計

      基于CPLD的多通道數(shù)據(jù)采集系統(tǒng)設(shè)計

      2009-09-01 | rar | 205 | 次下載 | 5積分

      資料介紹

      設(shè)計了以CPLD 為核心處理芯片的多路數(shù)據(jù)采集系統(tǒng)，按照正確的時序直接
      控制AD676和雙端口RAM的工作, 所有這些功能都采用VHDL語言進行描述。
      關(guān)鍵詞：CPLD, AD676, VHDL語言, 雙端口RAM，數(shù)據(jù)采集
      在數(shù)字技術(shù)飛速發(fā)展的今天, 將各種模擬信號轉(zhuǎn)化為數(shù)字信號再進行相應(yīng)的處理, 不
      僅可以提高系統(tǒng)性能, 還可以充分利用現(xiàn)代信號的各種處理算法。以往的多通道數(shù)字采集系統(tǒng)多數(shù)采用單片機、DSP等微處理器產(chǎn)生A/D轉(zhuǎn)換芯片所需要的控制時序，以及通道轉(zhuǎn)換所需要的時序邏輯信號，這樣會占用CPU較多的時間，特別在有語音、圖像處理的應(yīng)用場合會影響整個系統(tǒng)的信號處理速度。
      隨著工藝水平的不斷進步, 可編程器件CPLD (Complex Programmable Logical Device)
      的速度和規(guī)模都有了很大的提高, 而且, 它們還具有集成度高、體積小、功耗低、設(shè)計靈活等優(yōu)勢, 這就為利用可編程器件實現(xiàn)高速的信號采集和處理開辟了道路。本文介紹基于CPLD的多通道數(shù)據(jù)采集系統(tǒng)設(shè)計方法，所需控制時序及地址譯碼等電路均有CPLD產(chǎn)生，并將轉(zhuǎn)換結(jié)果放于雙端口RAM中，CPU可隨時從雙端口RAM讀取，以實現(xiàn)高速數(shù)據(jù)采集和處理。
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