如何使用FPGA實(shí)現(xiàn)神經(jīng)網(wǎng)絡(luò)硬件的設(shè)計(jì)方法
資料介紹
提出了一種可以靈活適應(yīng)不同的工程應(yīng)用中神經(jīng)網(wǎng)絡(luò)在規(guī)模、拓?fù)浣Y(jié)構(gòu)、傳遞函數(shù)和學(xué)習(xí)算法上的變化,并能及時(shí)根據(jù)市場需求快速建立原型的神經(jīng)網(wǎng)絡(luò)硬件可重構(gòu)實(shí)現(xiàn)方法.對神經(jīng)網(wǎng)絡(luò)的可重構(gòu)特征進(jìn)行了分析,提出了三種主要的可重構(gòu)單元;研究了可重構(gòu)的脈動(dòng)體系結(jié)構(gòu)及BP網(wǎng)絡(luò)到該結(jié)構(gòu)映射算法;探討了具體實(shí)現(xiàn)的相關(guān)問題.結(jié)果表明,這種方法不僅靈活性強(qiáng)。其實(shí)現(xiàn)的硬件也有較高的性價(jià)比,使用一片FPGA中的22個(gè)乘法器工作于100 MHz時(shí),學(xué)習(xí)速度可達(dá)432M CUPS.
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