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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>PCI總線仲裁參考設(shè)計(jì)Verilog代碼

      PCI總線仲裁參考設(shè)計(jì)Verilog代碼

      2008-05-20 | rar | 3 | 次下載 | 10積分

      資料介紹

      PCI總線仲裁參考設(shè)計(jì)，Quicklogic提供

      This application note describes a fully PCI-compliant Master/Slave
      interface. It utilizes the
      PCI burst transfer mode for transfers at high speed, up to 67 MBytes per
      second. Although it
      is designed to interface the Seeq 80C300 Ethernet Data Link Controller
      to the PCI bus, it can
      be easily modified to interface with other peripherals. Data is transferred
      between System
      Memory and the Ethernet controller in bursts of eight using Master Mode
      DMA. Internal
      80C300 programming registers are mapped into host memory space and
      are accessed using
      slave mode.

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